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Question

(C) दिए गए परिपथ में दो डायोड हैं जिनके एनोड इनपुट $A$ और $B$ से जुड़े हैं,और उनके कैथोड एक सामान्य आउटपुट टर्मिनल $C$ से जुड़े हैं,जो एक प्रतिरोधक के

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$OR$ गेट

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(C) दिए गए परिपथ में दो डायोड हैं जिनके एनोड इनपुट $A$ और $B$ से जुड़े हैं,और उनके कैथोड एक सामान्य आउटपुट टर्मिनल $C$ से जुड़े हैं,जो एक प्रतिरोधक के माध्यम से ग्राउंड से जुड़ा है।मान लीजिए कि लॉजिक स्तर $0$ (कम वोल्टेज) और $1$ (उच्च वोल्टेज) हैं।$1$. यदि $A=0$ और $B=0$ है,तो दोनों डायोड रिवर्स-बायस में होते हैं (या शून्य विभव पर),इसलिए आउटपुट $C=0$ प्राप्त होता है।$2$. यदि $A=1$ और $B=0$ है,तो $A$ से जुड़ा डायोड फॉरवर्ड-बायस में होता है,जो $C$ तक धारा प्रवाहित होने देता है,इसलिए $C=1$ प्राप्त होता है।$3$. यदि $A=0$ और $B=1$ है,तो $B$ से जुड़ा डायोड फॉरवर्ड-बायस में होता है,जो $C$ तक धारा प्रवाहित होने देता है,इसलिए $C=1$ प्राप्त होता है।$4$. यदि $A=1$ और $B=1$ है,तो दोनों डायोड फॉरवर्ड-बायस में होते हैं,और आउटपुट $C=1$ प्राप्त होता है।यह सत्यता सारणी (ट्रुथ टेबल) ($0,0 \rightarrow 0$; $1,0 \rightarrow 1$; $0,1 \rightarrow 1$; $1,1 \rightarrow 1$) एक $OR$ गेट के अनुरूप है।

$A$. स्मॉल स्केल इंटीग्रेशन $(SSI)$	$I$. लॉजिक गेट्स $< 100$
$B$. मीडियम स्केल इंटीग्रेशन $(MSI)$	$II$. लॉजिक गेट्स $> 1000$
$C$. लार्ज स्केल इंटीग्रेशन $(LSI)$	$III$. लॉजिक गेट्स $\leq 10$
$D$. वेरी लार्ज स्केल इंटीग्रेशन $(VLSI)$	$IV$. लॉजिक गेट्स $< 1000$

नीचे दिए गए परिपथ में,$A$ और $B$ दो इनपुट दर्शाते हैं और $C$ आउटपुट दर्शाता है। यह परिपथ क्या दर्शाता है?

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$NOR$ गेट किन दो गेटों का संयोजन है?

एक लॉजिक गेट की सत्य सारणी (truth table) नीचे दी गई है। गेट की पहचान करें।
इनपुट $A$ इनपुट $B$ आउटपुट $Y$
$0$ $0$ $1$
$0$ $1$ $1$
$1$ $0$ $1$
$1$ $1$ $0$

आकृति में दिए गए इनपुट $A$ और $B$ के लिए $OR$ गेट के आउटपुट वेवफॉर्म $(Y)$ का औचित्य सिद्ध कीजिए।

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